Схема ИЛИ-НЕ

Схема ИЛИ-НЕ

В последнем примере главы 9 мы рассматривали логическую схему 7400: 2-входовую схему ИЛИ-НЕ. В качестве источников V₁ и V₂ были использованы источники напряжения типа PWL с выходным напряжением в виде последовательностей импульсов, представляющих уровни логических нулей и единиц. Эта схема может быть введена и в Capture OrCAD, как показано на рис. 17.32. Чтобы создать V₁ и V₂, выберем компонент типа VPWL. Вспомним, как были описаны два источника в примере из главы 9:

V1 1 0 PWL(0s 0V 0.1ms 1V 1s 1V 1.0001S 0V

+ 2s 0V 2.0001s 1V 3s 1V 3.0001s 0V 4s 0V 4.0001s 1V 5s 1V)

V2 2 0 PWL((0s 0V 1.5s 0V 1.50001s 1V 2.5s 1V 2.50001s 0V

+ 3.5s 0V 3.50001s 1V 3.70001s 0V 5s 0V)

Рис. 17.32. Схема для исследования логического элемента И-НЕ 

Войдя в Capture, дважды щелкните на компоненте V1 и в появившемся окне Property Editor введите следующие пары время-напряжение: «0s 0V 0.1ms 1V 1s 1V 1.0001s 0V 2s 0V 2.0001s 1V 3s 1V 3.0001s 0V 4s 0V 4.0001s 1V». Отметим, что в Capture можно ввести только 10 пар время-напряжение, в то время как в PSpice их число не ограничено. Дважды щелкните на компоненте V2 и введите следующие пары время-напряжение: «0s 0V 1,5s 0V 1,50001s 1V 2,5s 1V 2,50001s 0V 3,5s 0V 3,50001s 1V 3,7s 1V 3,70001s 0V 5s 0V». Завершите схему, выбрав Place, Net Alias для узлов 1, 2 и Vout. Сохраните схему и подготовьте в PSpice новое моделирование с именем Norgate1. Выберите анализ переходных процессов на интервале t=5 мс с максимальным размером шага в 1 мс. Проведите анализ и получите в Probe графики V(1) и Vout, a V(2) — на отдельном графике, как показано на рис. 17.33. Курсор на рисунке показывает, что при t=1,2 с, когда и V(1) и V(2) равны логическому нулю, выход V_out равен логической единице. Уровни для обоих входных напряжений на этом графике совпадают с сеткой, что несколько затемняет картину.

Рис. 17.33. Диаграммы входных к выходного напряжений для элемента И-НЕ 

Небольшая часть выходного файла показана на рис. 17.34. Интереснее всего проследить, как входные напряжения задаются в соответствующих командах. В состав этой схемы входят как аналоговые, так и цифровые схемы, аналоговые источники VPWL подключены к логическому элементу И-НЕ 7402. Это заставляет программу PSpice создавать набор аналого-цифровых интерфейсов, что вносит в простой проект излишние осложнения.

**** 09/06/99 14:20:30 *********** Evaluation PSpice (Nov 1998) **************

** circuit file for profiles Norgate1

*Libraries:

* Local Libraries :

* From [PSPICE NETLIST] section of pspiceev.ini file:

.lib nom.lib

*Analysis directives:

.TRAN 0 5s 0 1ms

.PROBE

*Netlist File:

.INC "norgate-SCHEMATIC1.net"

*Alias File:

**** INCLUDING norgate-SCHEMATIC1.net ****

* source NORGATE

V_V2 2 0

+PWL 0s 0V 1.5s 0V 1.50001s 1V 2.5s 1V 2.50001s 0V 3.5s 0V 3.50001s 1V 3.7s 1V

+ 3.70001s 0V 5s 0V V_V1 1 0

+PWL 0s 0V 0.1ms 1V 1s 1V 1.0001s 0V 2s 0V 2.0001s 1V 3s 1V 3.0001s 0V 4s 0V

+ 4.0001s 1V

X_U1A 1 2 VOUT $G_DPWR $G_DGNV 7402 PARAMS:

+ IO_LEVEL=0 MNTYMXDLY=0

**** RESUMING norgate-SCHEMATIC1-Norgate1.sim.cir ****

.INC "norgate-SCHEMATIC1.als"

**** INCLUDING norgate-SCHEMATIC1.als ****

.ALIASES

V_V2  V2(+=2 -=0 )

V_V1  V1(+=1 -=0 )

X_U1A U1A(A=1 B=2 Y=VOUT VCC=$G_PWR GND=$G_DGND )

**** Generated AtoD and DtoA Interfaces ****

Рис. 17.34. Выходной файл для логического элемента ИЛИ-НЕ

Данный текст является ознакомительным фрагментом.